湖北省高等学校省级教学研究项目(2009164)
- 作品数：3 被引量：15H指数：2
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- 一种低噪声高PSRR的LDO线性稳压器被引量：2
- 2012年
- 介绍了LDO线性稳压器的系统组成原理,分析了系统的电源电压抑制比(PSRR)以及噪声与电路结构的关系,在此基础上,对LDO的核心电路模块进行了设计,并基于0.5μm标准CMOS工艺,运用Cadence平台进行了模拟仿真和验证.测试结果表明:该LDO的PSRR最低约为-45dB@1 MHz,最高约为-75dB@217Hz;输出电压噪声在10Hz频率以下约为0.78μV(P-P),在10Hz至100kHz频率范围内约为0.1μV(RMS),能满足低噪声和高PSRR应用的要求.
- 邹静杨维明蒋师刘雪
- 关键词：线性稳压器低噪声电源电压抑制比
- LTE中咬尾卷积编码器的VHDL设计
- 2012年
- 咬尾卷积码编码具有不要求传输任何额外比特的优点,成为LTE通信系统中重要的编码方式。在介绍LTE物理信道结构的基础上,分析了咬尾卷积码编码器的编码原理,设计了咬尾卷积编码器的工作时序,然后基于Quartus-Ⅱ平台对咬尾卷积码编码器进行了VHDL设计,并利用Modelsim进行了波形仿真与验证。结果表明:采用VHDL设计方法实现咬尾卷积码编码具有设计灵活、修改方便的特点,能满足LTE通信系统的编码要求。
- 李紫怡杨维明吴恙张磊
- 关键词：咬尾卷积码编码器VHDL
- 锁相环中无源环路滤波器的设计与仿真被引量：13
- 2011年
- 锁相环(PLL)的基本频率特性主要是由环路滤波器决定的.为了节省锁相环的设计仿真时间,提高设计效率,提出一种基于ADS仿真平台的环路滤波器系统级设计与仿真方法.分析RC无源滤波器截止频率与锁相速度之间的关系;引入滞后超前滤波器结构,提高PLL的稳定性,还分析滞后超前滤波器的幅度-频率特性,以及影响相位返回量的因素,并基于ADS仿真平台分析相位返回量的大小与环路锁相速度之间的关系,为环路滤波器设计提供理论依据.
- 刘丽平杨维明李倩陆曲
- 关键词：锁相环无源滤波器仿真
