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刘伯安

作品数：20 被引量：34H指数：4
供职机构：清华大学信息科学技术学院微电子学研究所更多>>
发文基金：国家高技术研究发展计划国家自然科学基金电子信息产业发展基金更多>>
相关领域：电子电信自动化与计算机技术电气工程更多>>

合作作者

文献类型

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领域

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  • 1篇电气工程

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  • 4篇神经网
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机构

  • 20篇清华大学
  • 1篇北京航空航天...

作者

  • 20篇刘伯安
  • 4篇周欣
  • 4篇涂春江
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  • 3篇石秉学
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  • 1篇微电子学

年份

  • 3篇2008
  • 5篇2007
  • 3篇2006
  • 5篇2005
  • 2篇2004
  • 2篇2003
共 20 条 记 录，以下是 1-10
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排序方式：
一种新型低电压LVDS发送器设计
2008年
本论文给出一种用0.18μm的CMOS工艺设计,工作电源电压是1.5V,可实现为2.5Gbps数据流的发送的LVDS(Low Voltage Differential Signal)发送器。为了补偿长距离高速传输的高频信号衰减,发送器对信号的高频部分进行了预加重。通过数字控制,可以让发送器工作在有/无发送端匹配电阻的不同状态,可以针对不同的信道条件选择工作模式。在有发送端匹配电阻存在的情况下,发送器在单端输出摆幅480mV的情况下消耗平均功率为34.2mW。
张岳刘伯安
关键词：预加重
一种IEEE 802.11b基带处理器的低硬件复杂度设计被引量：2
2005年
为了降低基带处理器的硬件复杂度以减少系统的成本,该文提出了一种适用于IEEE802.11b的基带处理器设计。重点描述了捕获、同步以及补偿码键控(CCK)解调方法。在捕获和同步过程中,采用了天线锁定技术,并且利用一种特殊转置结构的相关器完成了信号检测功能。CCK解调器包含快速Walsh变换(FWT)结构和符号判决单元,采用了一种新的算法和结构,降低了硬件复杂度。该芯片采用TSMC公司的0.25μm逻辑CMOS工艺设计,等效门数为32万门,版图面积为13mm2,仿真验证表明新的设计降低了硬件复杂度。
涂春江周欣刘伯安陈弘毅
关键词：数据处理基带处理器无线局域网IEEE
用于频率综合器的延迟锁相环的设计被引量：5
2007年
设计了一种宽频率锁定范围、倍频数可编程的延迟锁相环。它引入了条件振荡控制电路，使该电路在保持DLL一阶系统和低抖动性能优势的基础上吸收了PLL倍频数可编程的优点；同时，该电路结合了设置延迟初始值和采用新型鉴相器两种宽频技术，具有宽频率工作范围。该延迟锁相环用SMIC0．18μm 1．8V CMOS工艺实现，锁定范围为1．56～100MHz，可供选择的倍频数为1～16，输出频率范围从20MHz到100MHz。在输入最小频率、最大倍频数下，仿真的功耗约为9mW，抖动约为92ps。
上官利青刘伯安
关键词：延迟锁相环频率综合器
神经网络的空间分解方法求解热传导方程被引量：1
2005年
在微机电系统(MEMS)等众多领域的模拟中,都需要求解偏微分方程。常用的方法得到的都是数值形式的解。该文提出了一种利用人工神经网络得到偏微分方程的解析形式解的方法。把神经网络的工作区域划分为小的区域,用不同的神经网络逼近,计算精度提高了一倍,计算时间减少到十分之一以下。用它求解了二维空间上的静态热传导问题,得到了精确的解析形式的解。因为这种解可以方便地用于VHDL-AMS(VHSIChardwaredescriptionlanguage-analogandmixed-signal)模型,所以它可以用于各个领域的偏微分方程的模拟。
周欣刘伯安石秉学
关键词：人工神经网络偏微分方程热传导
一种新型混合信号时钟延时锁定环电路设计被引量：3
2007年
给出了数字时钟管理器(DCM)中的一种新型时钟延时锁定环电路(Clock Delay Locked Loop)的设计,为高速同步数据采集系统提供可靠的时钟解决方案。该电路设计是基于延时锁定环(DLL)原理上,采用混合信号电路设计方案来实现。设计中的数字电路控制模块,通过对改进后的电荷泵中的附加开关工作时间的精确控制来实现对输入时钟信号所需延时的精确控制,从而得到所需的延时。该电路不会累积相位误差,具有良好的噪声敏感度。电路采用0.18μm的CMOS工艺,工作电压1.5V,可管理的时钟信号最高频率为360MHz,延时范围为1T,延时精度为T/32。
朱曼子刘伯安
关键词：电荷泵数字鉴相器
一种电流型积分器自动调节系统设计
2008年
本文给出一种用于电流型连续时间Σ/Δ调制器(Σ/Δmodulator)中的跨导积分器(OTA-C integrator)的自动调节系统。该系统由原Σ/Δ调制器中跨导器,积分器及反馈数模转换器(feedback DAC)的复制品,峰值检测器(peakdetector)和反馈放大器组成。该系统已在0.18μm标准CMOS工艺下经过仿真。仿真结果显示对于1GHz过采样时钟频率的Σ/Δ调制器,该系统能够将由于积分器各参数变化引起的输出幅度变化减小一个数量级以上。
胡翔刘伯安
可配置参数的BCH编解码器的设计被引量：2
2007年
介绍了参数化的BCH编解码器的设计,并用verilog HDL实现。可由外部端口输入信号配置编码参数,以适应各种通信环境,达到最佳的数据传输率。工作时钟频率为500MHz。
张海燕刘伯安
关键词：纠错编码BCH纠错能力
无线局域网芯片组的开发
石秉学廖青李永明刘伯安沈延钊池保勇陈继伟冯东王永海邱晓海胡海星尚维轶郑吉华赵国光朱丹阳
产品采用DSSS直接序列扩频调制方式，支持11Mbps数据传输速率，工作频率为2.4GHz。RF部分即为射频收发器前端，包括IQ正交调制解调、RF/IF转换、频率合成器（包括VCO）和功率放大器。基带部分包括基带信号处理...
关键词：
关键词：无线局域网
新型低电压能隙基准电压源被引量：4
2006年
介绍了一种新型能隙基准电压源电路,此电路在smic0.18rfms工艺条件下设计,它可以输出大小为616mV的基准电压,只要当电源电压在1.1,2.5V之间,此基准电压的输出浮动不超过2.2mV。
张家川刘伯安
关键词：低电压能隙基准电压源
基于DLL的1.25G超宽带通信系统时钟生成电路被引量：1
2007年
设计并实现了一个基于延时锁定环(DLL)、用于超宽带(UWB)无线通信系统的1.25GHz时钟生成电路。该时钟生成电路由两个DLL和一个自调谐LC滤波电路组成,输入125MHz的参考时钟,输出1.25GHz的差分时钟和间隔100ps的16相时钟。通过优化电荷泵电路有效地减小了静态相位误差,新式自调谐LC滤波电路的应用消除了工艺偏差对谐振的影响。在1.8V电源电压,SMIC0.18μmCMOS工艺下,该时钟生成电路在各种工作条件下均表现出良好的性能,在标准情况下静态相位误差仅为9ps,最大时钟抖动为10ps。当电感存在30%的工艺偏差时,滤波电路的谐振频率能够自动维持在1.25GHz上。
陈忱刘伯安
关键词：电荷泵延时锁定环
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