陆平静
- 作品数：109 被引量：18H指数：3
- 供职机构：国防科学技术大学更多>>
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- 相关领域：自动化与计算机技术电子电信理学更多>>
- 面向高速缓冲存储器的可综合伪随机验证方法及装置
- 本发明公开了一种面向高速缓冲存储器的可综合伪随机验证方法及装置，方法步骤如下：1)建立数据镜像模块并初始化；2)生成伪随机数，构造访存控制数据信号并发送到高速缓冲存储器，同时启动超时计数器并在超时后报告超时错误；当收到高...
- 张建民罗章徐金波董德尊赖明澈陆平静黎铁军王绍刚徐炜遐肖立权庞征斌王克非夏军童元满陈虎张峻齐星云王桂彬常俊胜
- 基于集群系统的计算机体系结构方案并行模拟优选方法
- 本发明公开了一种基于集群系统的计算机体系结构方案并行模拟优选方法，目的是提供一种计算机体系结构设计方案并行模拟优选的方法。技术方案是先构建具备远程命令执行环境的由主控节点和模拟节点组成的集群并行计算机系统，主控节点上安装...
- 车永刚徐传福王勇献王正华陆平静曹维方建滨翁玉芬
- 文献传递
- 立方体超结点多平面互连的高性能计算机及其通信方法
- 本发明公开了一种立方体超结点多平面互连的高性能计算机及其通信方法，本发明的高性能计算机包括多组立方体超结点，每一组立方体超结点包括S个交换板，立方体超结点包括八个计算结点，其中四个计算结点通过网络接口芯片首尾相连形成环形...
- 齐星云陆平静马迪赖明澈徐佳庆熊泽宇唐付桥王强欧洋
- 基于多维尺度变换的虫洞拓扑识别方法
- 本发明公开了一种基于多维尺度变换的虫洞拓扑识别方法，实施步骤如下：1)网络图中的每个节点分别获取局部化连接关系图，获取局部化连接关系图中所有节点之间的最短距离矩阵；2)以最短距离矩阵为输入，利用多维尺度变换对局部化连接关...
- 董德尊鲁晓佩廖湘科赖明澈陆平静王绍刚徐炜遐肖立权庞征斌王克非夏军童元满陈虎张峻齐星云王桂彬常俊胜张建民罗章徐金波
- 一种基于动态阈值的高速网络拥塞控制方法和装置
- 本发明公开了一种基于动态阈值的高速网络拥塞控制方法和装置，本发明基于动态阈值的高速网络拥塞控制方法包括：检测当前时刻的端口缓冲队列长度的梯度G；基于端口缓冲队列长度的梯度G表示的队列的变化趋势来动态调整基于拥塞打标ECN...
- 孙岩常俊胜黎渊张建民罗章欧洋徐金波陆平静熊泽宇王子聪王强吕方旭翦杰
- 融合高速网链路层与100G以太网编码层的适配装置
- 本发明公开了一种融合高速网链路层与100G以太网编码层的适配装置，本发明包括发送转换模块(adaptor_tx_trans)、发送模块(adaptor_tx)、回环模块(adaptor_lb)、接收模块(adaptor_...
- 曹继军王超赖明澈常俊胜齐星云徐佳庆罗章陆平静王武芳吕方旭孙岩熊泽宇王强
- 文献传递
- 一种网络拥塞控制方法
- 发明提提供了一种网络拥塞控制方法，在发送端发送流数据前在缓冲区设置令牌桶，向接收端发送信用请求，接收所述接收端发来的信用包，根据所述信用包增加所述缓冲区中所述令牌桶容量，当待发送数据包大小小于所述令牌桶容量大小，则发送数...
- 董德尊周泽嘉陆平静徐金波张建民罗章欧洋
- 一种融合网络接口卡、报文编码方法及其报文传输方法
- 本发明提供一种融合网络接口卡、报文编码方法及其报文传输方法，包含PCIE主机接口处理模块、高速网网卡核心逻辑、交叉开关XBAR、以太网网卡核心逻辑、以太网报文拆分/拼装模块、物理层逻辑，高速网/以太网报文转换模块EoH以...
- 肖立权常俊胜赖明澈庞征斌陆平静罗章黎渊张建民齐星云徐金波孙岩董德尊
- 文献传递
- 结合模型和迭代编译优化矩阵相乘程序被引量：1
- 2009年
- 高性能计算应用程序获得的持续性能与机器峰值性能的差距日益扩大,很大程度上制约着高性能计算的发展。程序变换通过对程序进行适应机器体系结构特征的优化变换,提高程序实际执行性能,是解决该问题的有效途径之一。很多高级程序变换均具有数值参数,为了获得最优性能,需要仔细选择参数的值。传统的编译器使用简单的模型选择这些参数,难以适应日趋复杂的硬件平台和应用程序。迭代编译通过生成不同的程序版本并在实际硬件评估上运行程序,来评估关键优化参数的值并决定能够产生最优性能的值,显著优于静态方法,但巨大的优化开销限制了其应用范围。本文针对矩阵相乘程序提出一种结合性能模型和迭代编译的优化方法,利用基于对机器体系结构和程序的经验知识构造性能模型约束优化空间,并使用遗传算法加速在优化空间中寻找优秀解的过程。实验结果表明,该方法可以较低的开销获得更优的性能优化效果。
- 陆平静王正华车永刚
- 关键词：遗传算法
- 用于大规模FPGA平台的多时钟域精准停顿与恢复电路及方法
- 本发明公开了一种用于大规模FPGA平台的多时钟域精准停顿与恢复电路及方法，本发明的电路包括数字时钟管理模块、全局门控时钟、触发时间戳计数器、门控时钟控制逻辑、控制与状态寄存器、N个门控时钟及其分频控制器及用户逻辑模块，全...
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