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余向阳

作品数：36 被引量：0H指数：0
供职机构：中国兵器工业集团更多>>
相关领域：自动化与计算机技术电子电信兵器科学与技术更多>>

合作作者

文献类型

  • 36篇中文专利

领域

  • 9篇自动化与计算...
  • 2篇电子电信
  • 1篇兵器科学与技...

主题

  • 12篇电路
  • 7篇总线
  • 6篇逻辑控制
  • 5篇时钟
  • 5篇串行
  • 4篇引信
  • 4篇时钟信号
  • 4篇转换电路
  • 4篇逻辑控制单元
  • 4篇接口
  • 4篇控制单元
  • 4篇集成电路
  • 3篇多路
  • 3篇延时
  • 3篇运算电路
  • 3篇通信
  • 3篇图像
  • 3篇总线协议
  • 3篇脉冲
  • 3篇管理单元

机构

  • 36篇中国兵器工业...

作者

  • 36篇余向阳
  • 32篇汪健
  • 23篇张磊
  • 10篇徐叔喜
  • 9篇王丽丽
  • 9篇赵忠惠
  • 8篇张瑾
  • 6篇刘成玉
  • 5篇谢斌
  • 4篇陈远金
  • 4篇王少轩
  • 2篇张跃玲
  • 2篇龙善丽
  • 2篇李金宝
  • 2篇王英武
  • 2篇吴慧
  • 2篇白涛
  • 2篇杜松
  • 2篇张宪起
  • 2篇刘霞

年份

  • 9篇2024
  • 2篇2023
  • 1篇2022
  • 3篇2021
  • 2篇2020
  • 1篇2019
  • 1篇2018
  • 1篇2017
  • 2篇2016
  • 3篇2015
  • 3篇2014
  • 3篇2013
  • 3篇2012
  • 2篇2011
共 36 条 记 录，以下是 1-10
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排序方式：
五路PWM电机控制电路
<B>本发明公开一种五路</B> <B>PWM</B> <B>电机控制电路，包括微控制器、</B> <B>PWM</B> <B>控制器、</B> <B>AD</B> <B>转换器及</B> <B>DA</B> <B>转换...
张宪起李金宝谢斌王丽丽余向阳周冬莲杜松冯业胜汪健
一种引信启动地址识别容错方法
本发明公开了一种引信启动地址识别容错方法，包括以下步骤：步骤1）引信电路上电复位后，在t1、t2和t3时刻分三次识别启动信号和地址线状态，若三次识别中有两次信号状态一致，确认地址线状态；步骤2）若三次识别结果均不一致，则...
赵忠惠汪健赵洪军余向阳张瑾王英武
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一种带AXI接口的通用多路PWM发生器
本发明公开了一种带AXI接口的通用多路PWM发生器，包括AXI接口、PWM内部寄存器、内部逻辑控制、PWM输出、PWM中断和定时器计数器；AXI接口接受SoC系统中的微处理器发出的读写时序和配置信息；PWM内部寄存器包括...
张跃玲汪健张磊陈亚宁余向阳王丽丽
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一种CPU与FPGA间的网络层通信方法
本发明公开了一种CPU与FPGA间的网络层通信方法，包括以下过程：主机CPU或设备FPGA按照SDIO/eMMC协议向通信对方传输数据，按照传输的数据量进行单帧和多帧传输；数据传输过程中的数据帧包括协议控制信息和数据两个...
吴凡张磊汪健赵忠惠张瑾余向阳徐叔喜刘源王佚楠曾鑫
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多链路通道的串行解串IP
本发明公开了多链路通道的串行解串IP，包括物理媒介适配层PMA和原始物理编码子层PCS两部分，所述原始物理编码子层PCS与特定PCS协议连接在一起，构成一个完整的物理层，支持多个物理媒介适配层PMA和原始物理编码子层PC...
赵忠惠陈亚宁余向阳汪健濮嵩
一种用于AXI总线的ID号压缩装置
本发明公开了一种用于AXI总线的ID号压缩装置，所述ID号压缩装置设置于AXI总线中，所述ID号压缩装置包括ID号存储单元和同步FIFO模块；所述ID号存储单元，用于存储同步FIFO模块中的有效数据，用于实际ID号到虚拟...
张磊余向阳张瑾汪健
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一种基于总线接口的数学运算加速器集成电路
本发明公开了半导体集成电路中IP设计技术领域的一种基于总线接口的数学运算加速器集成电路，包括AXI总线，集成于SoC片上系统中；DMA模块，与AXI总线通信连接，用于通过AXI总线从SoC片上系统中读取操作数和操作指令，...
张磊余向阳徐叔喜汪健
一种基于RISC-V芯片的FPGA原型验证平台
本发明公开了一种基于RISC‑V芯片的FPGA原型验证平台，包括：RISC‑V芯片，在FPGA逻辑资源中实例化RISC‑V处理器核，RISC‑V处理器核实现了标准RISC‑V指令集，支持RV32I/RV64I基础整数指令...
吴杰蔡思聪张磊余向阳汪健
电动舵机用单芯片数字控制器及单双极调制输出控制方法
本发明涉及一种电动舵机用单芯片数字控制器，它包括控制量输入逻辑电路、状态检测逻辑电路、将控制量M转换为正向驱动脉冲宽度P或/和反向驱动脉冲宽度N输出的算术运算逻辑电路、用于接收控制寄存器的控制信息以及状态检测逻辑电路的输...
谢斌余向阳王丽丽徐叔喜
时钟源自动管理电路
本发明涉及一种时钟源自动管理电路，包括晶体振荡器、RC振荡器、输出时钟信号的时钟选择模块、设置有延时时间并提供延时信号的RC延时器、设置有停振延时时间并提供停振延时时间信号的延时监测模块、振荡判断管理模块、存储有振荡状态...
汪健何汪来王少轩余向阳刘立华陈亚宁
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