李刚
- 作品数：17 被引量：60H指数：4
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- 相关领域：自动化与计算机技术航空宇航科学技术更多>>
- 寻址与存储单元一体化双端口存储控制器
- 寻址与存储单元一体化双端口存储控制器，包括双端口RAM存储单元，两个独立读写端口的控制器，每个读写端口控制器包括命令寄存及地址暂存控制模块，组合逻辑电路模块，脉冲分配器，数据传输控制模块，地址通道控制模块，读写仲裁电路模...
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- 文献传递
- 寻址与存储单元一体化双端口存储控制器
- 寻址与存储单元一体化双端口存储控制器，包括双端口RAM存储单元，两个独立读写端口的控制器，每个读写端口控制器包括命令寄存及地址暂存控制模块，组合逻辑电路模块，脉冲分配器，数据传输控制模块，地址通道控制模块，读写仲裁电路模...
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- 文献传递
- 基于emWin图形库的四旋翼飞行器监控系统设计被引量：4
- 2015年
- 为了对四旋翼飞行器在飞行过程中实现更加便利的监控,采用LPCI788微处理器和emWin图形库设计了四旋翼飞行器监控系统;按照监控系统的整体设计方案,设计了监控系统的硬件结构以及软件主体框架和程序流程,制定了无线模块的应用层通信协议,调用emWin的API函数创建四旋翼监控系统触摸显示控制屏界面;四旋翼飞行器经过多次飞行测试验证,监控系统实现了同时显示四旋翼飞行器的飞行姿态数据以及控制飞行器启动、飞行和着陆的功能,运行效果好,实用性强。
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- 关键词：四旋翼监控系统
- 浮点数除运算执行控制器
- 一种浮点数除运算执行控制器，包括浮点操作数配置控制模块、浮点数除运算器、脉冲发生分配控制器、结果输出控制模块；该执行控制器应用FPGA设计硬连接控制电路，在脉冲发生分配控制器产生的时序脉冲控制下自主完成参与运算的2个操作...
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- 文献传递
- 多浮点操作数加/减运算控制器
- 一种多浮点操作数加/减运算控制器，包括命令字及操作数写时序控制模块、操作数存储器、操作数读时序控制模块、运算与输出控制模块；该控制器应用FPGA设计硬连接控制电路，控制器被系统选中，在系统第一个WR的作用下发出写时序脉冲...
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- 文献传递
- 多浮点操作数加/减运算控制器
- 一种多浮点操作数加/减运算控制器，包括命令字及操作数写时序控制模块、操作数存储器、操作数读时序控制模块、运算与输出控制模块；该控制器应用FPGA设计硬连接控制电路，控制器被系统选中，在系统第1个WR的作用下发出写时序脉冲...
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- 文献传递
- 双指令多浮点操作数除运算控制器
- 一种双指令多浮点操作数除运算控制器，包括双端口只读只写存储器、命令及其多操作数写时序控制模块、浮点操作数读时序控制模块、存储器数据空标志控制器和配置运算与输出控制模块；该控制器应用FPGA设计硬连接控制电路，能够存储两条...
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- 文献传递
- 浮点数除运算执行控制器
- 一种浮点数除运算执行控制器，包括浮点操作数配置控制模块、浮点数除运算器、脉冲发生分配控制器、结果输出控制模块；该执行控制器应用FPGA设计硬连接控制电路，在脉冲发生分配控制器产生的时序脉冲控制下自主完成参与运算的2个操作...
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- 文献传递
- FPGA数据总线宽度不相等的双口RAM的设计被引量：7
- 2014年
- 目前双口RAM两个端口的数据总线宽度相等,而实际应用中,存在着双口RAM两个端口连接的系统的数据总线宽度不相等的问题,为此提出两个端口数据总线宽度不同的双口RAM的FPGA设计方法,双口RAM内部存储器的个数根据2个数据总线宽度比进行设计,在数据总线宽度小的端口设计逻辑控制电路,满足该端口分时进行的读写操作;根据这种双口RAM的读写操作特点,两个端口同时对某一存储单元进行读写操作时,设计存储单元数据总线宽度小的端口具有读写优先权的仲裁机制。对应用Verilog HDL设计的这种双口RAM进行了综合仿真测试,结果表明该双口RAM读写操作正确,具有可行性和实用性。
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- 关键词：仲裁
- 小型PLC的数据配置与ARM-FPGA总线接口的研制
- 本课题研究的是一种基于ARM+FPGA构架的小型PLC系统。其中,FPGA部分负责完成定时、计数、输入输出、多操作位逻辑运算等功能,ARM部分负责对PLC指令的静动态编译,以及对自身存储器和FPGA各功能模块的数据配置。...
- 李刚
- 关键词：数据配置并行总线异常处理
- 文献传递
